计算机组成原理 第五版 习题答案
CPU 地址 寄存器
32K *8 32K *8
32K *8 CS3 32K *8 32K *8 CS2 32K *8 32K *8 CS1 32K *8 CS0 数据 寄存器
A16 A15 2:4 译码器 CS0 ~ CS3 7.(1)组内地址用 A12~A0 (2)小组译码器使用 3：8 译码器 (3)RAM1~RAM5 各用两片 8K*8 的芯片位并联连接
0000H 4000H 6000H 8000H A000H C000H E000H
ROM RAM1 RAM2 RAM3 RAM4 RAM5
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A
0?A12 ROM RAM RAM RAM RAM RAM 8K*8 8K*8 8K*8 8K*8 8K*8
D0?D15 CPU RAM RAM RAM RAM RAM 8K*8 8K*8 8K*8 8K*8 8K*8
3:8译码器 A13?A15
8.顺序存储器和交叉存储器连续读出 m = 8 个字的信息总量都是：
q = 64 位*8 = 512 位
顺序存储器和交叉存储器连续读出 8 个字所需的时间分别是：
t1 = mT = 8*100ns = 8*10-7s
t 2 ??T ??(m ??1)????100ns ??7 * 50ns ??450ns ??4.5 *10?7 ns 顺序存储器和交叉存储器的带宽分别是：
Wq / t?7 ) ??64 ?107 1 ??1 ??512 ??(8 *10[位 / s]
W/ t?7 7 2 ??q 2 ??512 ??(4.5 *10) ??113.8 ?10[位 / s] 9.cache 的命中率
H ??
N c
N ??N ? 2420 ??0.968 c m 2420 ??80
r ??
Tm
T??
240 c
40 ??6
cache/主存系统效率 e 为
e ? 1 r ??(1 ??r)H *100% ??1 6 ??(1 ??6) * 0.968 *100% ??86.2%
平均访问时间 Ta 为
T ??
Tc
? 40ns 0.862ns
??46.4ns
a
e
10. h*tc+(1-h)*tm = ta
h ??t50 ??200 a ??tm ????93.75% tc ??tm
40 ??200
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11.设取指周期为 T，总线传送周期为τ，指令执行时间为 t0
(1)t = (T+5τ+6t0)*80 = 80T+400τ+480 t0 (2) t = (T+7τ+8t0)*60 = 60T+420τ+480 t0 故不相等。 12.D
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